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三值維持阻塞JKL觸發(fā)器的研究

吳浩敏,  莊南

吳浩敏, 莊南. 三值維持阻塞JKL觸發(fā)器的研究[J]. 電子與信息學(xué)報(bào), 1991, 13(2): 113-118.
引用本文: 吳浩敏, 莊南. 三值維持阻塞JKL觸發(fā)器的研究[J]. 電子與信息學(xué)報(bào), 1991, 13(2): 113-118.
Wu Haomin, Zhuang Nan. RESEARCH INTO TERNARY EDGE-TRIGGERED JKL FLIP-FLOP[J]. Journal of Electronics & Information Technology, 1991, 13(2): 113-118.
Citation: Wu Haomin, Zhuang Nan. RESEARCH INTO TERNARY EDGE-TRIGGERED JKL FLIP-FLOP[J]. Journal of Electronics & Information Technology, 1991, 13(2): 113-118.

三值維持阻塞JKL觸發(fā)器的研究

RESEARCH INTO TERNARY EDGE-TRIGGERED JKL FLIP-FLOP

  • 摘要: 本文提出一種具有三軌輸出的三值維持阻塞JKL觸發(fā)器的設(shè)計(jì),經(jīng)計(jì)算機(jī)邏輯模擬和通過(guò)測(cè)試由TTL門電路組成的實(shí)驗(yàn)電路表明,該觸發(fā)器能實(shí)現(xiàn)預(yù)定的邏輯功能。
    Abstract: The design of ternary cdge-triggered JKL-type filp-flop is proposed. The computer simulation and the test in experimental circuit made up with TTL gate show this flip-flop has the expected logic functioas.
    • HTML全文
  • Z. G. Vranesic, IEEE Trans. on C, C-26(1977), 1181-1182.[2]吳訓(xùn)威,陳偕雄,中國(guó)科學(xué)A輯,28(1945)7,643-654.[3]吳訓(xùn)威,陳偕雄,科學(xué)通報(bào),31(1986)19,1457-1459.[4]莊南,科學(xué)通報(bào),33(1988)12,906-908.[5]羅朝杰,數(shù)學(xué)邏輯設(shè)計(jì)基礎(chǔ)(下冊(cè)),人民郵電出版社,1983年,第31-39頁(yè).[6]吳訓(xùn)威,莊南,胡國(guó)安,杭州大學(xué)學(xué)報(bào)(自然科學(xué)版),12(1985)1,62-69.[7]吳訓(xùn)威,陳偕雄,電子學(xué)報(bào),1988年,第3期,第35-41頁(yè).[8]X. Wu, F. Prosser, Binary-ternary Mixed-Valued Counter, Proc. IEEE Int. Symp. on MVL, U.S. A,(1987), pp. 53-60.[9]陳偕雄,吳浩敏,電子學(xué)報(bào),1989年,第4期,第75-80頁(yè).
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出版歷程
  • 收稿日期:  1990-05-26
  • 修回日期:  1900-01-01
  • 刊出日期:  1991-03-19

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