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施密特電路的時(shí)序特征及門級(jí)設(shè)計(jì)

吳訓(xùn)威 汪鵬君

吳訓(xùn)威, 汪鵬君. 施密特電路的時(shí)序特征及門級(jí)設(shè)計(jì)[J]. 電子與信息學(xué)報(bào), 2001, 23(5): 491-496.
引用本文: 吳訓(xùn)威, 汪鵬君. 施密特電路的時(shí)序特征及門級(jí)設(shè)計(jì)[J]. 電子與信息學(xué)報(bào), 2001, 23(5): 491-496.
Wu Xunwei, Wang Pengjun . THE SEQUENTIAL CHARACTERISTIC OF SCHMITT CIRCUIT AND ITS DESIGN AT GATE LEVEL[J]. Journal of Electronics & Information Technology, 2001, 23(5): 491-496.
Citation: Wu Xunwei, Wang Pengjun . THE SEQUENTIAL CHARACTERISTIC OF SCHMITT CIRCUIT AND ITS DESIGN AT GATE LEVEL[J]. Journal of Electronics & Information Technology, 2001, 23(5): 491-496.

施密特電路的時(shí)序特征及門級(jí)設(shè)計(jì)

THE SEQUENTIAL CHARACTERISTIC OF SCHMITT CIRCUIT AND ITS DESIGN AT GATE LEVEL

  • 摘要: 該文根據(jù)施密特電路對(duì)輸入信號(hào)具有兩種檢測(cè)閾值的工作特點(diǎn),提出了施密特電路與用作存貯元件的觸發(fā)器之間具有相同的時(shí)序特征。利用時(shí)序電路的設(shè)計(jì)方法,本文系統(tǒng)地研究了基于集成門電路的各種施密特電路,并發(fā)現(xiàn)了一些新的設(shè)計(jì)方案。PSPICE模擬證明所設(shè)計(jì)的電路具有理想的施密特電路特性。
  • 間閻,數(shù)字電了技術(shù)基礎(chǔ)(第三版),北京,高等教育出版社, 1989,320-332.[2]J.M.Rabaey,Digital Integrated Circuits,A Design Perspective,New York,Prentice-Hall Inter-national,Inc,1996,363-369.[3]杭國(guó)強(qiáng),吳訓(xùn)威.基于開關(guān)信號(hào)理論的電流控闡技術(shù)三值ECL施密特電路,電子學(xué)報(bào), 1997,25[5),49-52.[4]Hang Guoqiang,Wu Xunwe,Research on ternary TTL Schmitt trigger,J.of Electronics(China),1998,15(1):35-42.[5]杭國(guó)強(qiáng)、吳訓(xùn)威,基于開關(guān)厲號(hào)理論的控聞技術(shù)與二值ECL施密持電路,電路與系統(tǒng)學(xué)報(bào),1998,3(2),15-20.[6]Shen Jizhong ,P.D.Tougaw,Design of symmetric ternary current-mode CMOS Schmitt inverter,Int.J.Electronics,1998,85(4),477-482.[7]吳訓(xùn)威,趙小杰,脈沖電路中的變閥技術(shù)-施密持電路,電子與儀表技術(shù), 1992,(2),1-5.[8]譚建生,李東,陳維良,數(shù)字電路與邏輯設(shè)計(jì),北京,電子工業(yè)出版社, 1998,26l-263.
  • 加載中
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出版歷程
  • 收稿日期:  1999-07-20
  • 修回日期:  1999-12-19
  • 刊出日期:  2001-05-19

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