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磁盤(pán)陣列中高速并行RS譯碼算法研究

王福文 董燕琴 李兵

王福文, 董燕琴, 李兵. 磁盤(pán)陣列中高速并行RS譯碼算法研究[J]. 電子與信息學(xué)報(bào), 2002, 24(5): 691-695.
引用本文: 王福文, 董燕琴, 李兵. 磁盤(pán)陣列中高速并行RS譯碼算法研究[J]. 電子與信息學(xué)報(bào), 2002, 24(5): 691-695.
Wang Fuwen, Dong Yanqin, Li Bing. Research on high speed and parallel RS decoding algorithm in disk array[J]. Journal of Electronics & Information Technology, 2002, 24(5): 691-695.
Citation: Wang Fuwen, Dong Yanqin, Li Bing. Research on high speed and parallel RS decoding algorithm in disk array[J]. Journal of Electronics & Information Technology, 2002, 24(5): 691-695.

磁盤(pán)陣列中高速并行RS譯碼算法研究

Research on high speed and parallel RS decoding algorithm in disk array

  • 摘要: 該文在總結(jié)研究 RS譯碼的基礎(chǔ)上,給出了一種適合并行方式進(jìn)行高速 RS譯碼的方法,該方法對(duì)于高速數(shù)據(jù)磁盤(pán)陣列錄取系統(tǒng)、高速數(shù)據(jù)通信系統(tǒng)的糾錯(cuò)譯碼效果顯著,已成功地應(yīng)用到磁盤(pán)陣列高速數(shù)據(jù)錄取系統(tǒng)中。
  • W.A. Burkhard, J. Menon, Disk array storage system reliability, In 23rd International Symposium on Fault-Tolerant Computing, Toulouse, France, June 1993, 432-441.[2]G.A. Gibson, L. Hellerstein, R. M. Karp, R. H. Katz, D. A. Patterson, Failure correction techniques for large disk arrays, In Third International Conference on Architectural Support for Programming Languages and Operating Systems, Boston, MA, Apr. 1989, 123-132.[3]H. Brunner, A. Curiger, M. Hofstetter, On computing multiplicative inverses in GF(2m), IEEE Trans. on Comput., 1989, 42(8), 1010-1015.[4]C.C. Wang, T. K. Truong, K. wang, H. M. Shao, L. J. Deutsch, J. K. Omura, I. S. Reed,VLSI architectures for computing multiplication and inverse in, IEEE Trans. on Comput., 1985,C-34(8), 709-717.[5]I.S. Hsu, T. K. Truong, L. J. Deutsch, I. S. Reed, A comparison of VLSI architecture of finite field multipliers using dual, normal, or standard bases, IEEE Trans. On Comput., 1988, 37(6),735-739.[6]S.T.J. Fenn, M. Benaissa, D. Taylor, multiplication and division over the dual basis, IEEE Trans. On Comput., 1996, 45(3), 319-327.[7]S.T.J. Fenn, M. Benaissa, D. Taylor, Division in GF(2m), Electron. Lett., 1992, 28(19), 2259-2261.[8]S.T.J. Fenn, M. Benaissa, D. Taylor, Improved algorithm for division over, Electron. Lett.,1993, 29(4), 469-470.[9]G.L. Feng, A VLSI Architecture for Fast Inversion in GF(2m), IEEE Trans. on Comput., 1989,38(10), 1383-1386.[10]Kuang Uung Liu, Architecture for VLSI design of Reed-Solomon decoders, IEEE Trans. on Comput, 1984, C-33(2), 178-189.
  • 加載中
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出版歷程
  • 收稿日期:  2000-11-24
  • 修回日期:  2001-06-09
  • 刊出日期:  2002-05-19

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