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新型CMOS JK觸發(fā)器

吳訓(xùn)威,  汪鵬君,  沈雁飛

吳訓(xùn)威, 汪鵬君, 沈雁飛. 新型CMOS JK觸發(fā)器[J]. 電子與信息學(xué)報(bào), 2005, 27(2): 334-336.
引用本文: 吳訓(xùn)威, 汪鵬君, 沈雁飛. 新型CMOS JK觸發(fā)器[J]. 電子與信息學(xué)報(bào), 2005, 27(2): 334-336.
Wu Xun-wei, Wang Peng-jun, Shen Yan-fei. Novel CMOS JK Flip-Flop[J]. Journal of Electronics & Information Technology, 2005, 27(2): 334-336.
Citation: Wu Xun-wei, Wang Peng-jun, Shen Yan-fei. Novel CMOS JK Flip-Flop[J]. Journal of Electronics & Information Technology, 2005, 27(2): 334-336.

新型CMOS JK觸發(fā)器

Novel CMOS JK Flip-Flop

  • 摘要: 該文以雙反相器閂鎖電路為基本存貯單元,采用開關(guān)級(jí)設(shè)計(jì)方法設(shè)計(jì)出一種新型的CMOS JK觸發(fā)器。與傳統(tǒng)設(shè)計(jì)相比,新設(shè)計(jì)具有較簡單的結(jié)構(gòu)、較少的元件以及較快的工作速度。
    Abstract: Taking the latch composed of two inverters as basic storage unit, this paper proposes a novel CMOS JK flip-flop based on the design at switch level. The new design has simpler configuration with less devices and faster working speed in comparing with the traditional design.
    • HTML全文
  • Telllez G E, Farrah A, Sarrafzadeh M. Activity-driven clock design for low power circuits. Proc. IEEE ICCD, TX, USA, 1995,11: 62- 65.[2]王倫耀,吳訓(xùn)威.主從型D觸發(fā)器的動(dòng)態(tài)功耗分析.浙江大學(xué)學(xué)報(bào)(理學(xué)版), 2003,30(1):35-40.[3]Wu X (吳訓(xùn)威), Wei J (韋健). CMOS edge-triggered flip-flop using one latch[J].Electron. Lett.1998, 34 (16):1581-[4]Wu X (吳訓(xùn)威). Theory of transmission switches and its application to design of CMOS digital circuits[J].International Journal of Circuit Theory and Application.1992, 20(4):349-[5]Rabaey J M. Digital Integrated Circuits: A Design Perspective.New York: Prentice-Hall Inc. 1996:60 - 62.
  • 加載中
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出版歷程
  • 收稿日期:  2003-06-10
  • 修回日期:  2004-09-22
  • 刊出日期:  2005-02-19

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